迅辉好品质(在线咨询)_触发器_广东触发器

公司是****生产，经营UV变压器，镇流器，UV灯，晒版灯，及其它配套产品的直接厂家，公司成立于2000年，已具有相当的规模，技术力量雄厚，UV触发器，产品品种齐全，已经应用与多种行业，如PCB行业，印刷业，触发器，木地板业。我们的宗旨是:“以准时求信誉，以精品求发展”。诚信、快捷、以超低的价格提供****的服务!力求让每一个客户都满意 ！

1. 理论上讲，如果亚稳态不能够在一个时钟周期内返回到稳定态，那么目的寄存器也会发生亚稳态。这就是亚稳态的传播。

2. 亚稳态的毛刺直接输出，有可能导致系统错误。比如毛刺信号送给CPU做中断，可能导致CPU产生错误的中断响应。

3. 采样到错误的电平，导致功能错误。这是逻辑设计人员****容易遇到的问题。****典型的例子是，假设有一个4bits one-hot编码的状态机。正常的功能只有四个状态0，2，4，8。但是这个状态机的有多个异步输入信号，那么就会发生亚稳态。我们知道，亚稳态返回到1或者0是随机的，这样就会出现状态机的输入有不良的组合，导致状态机进入到不良状态{1，3，5，6，7，9，黑色触发器，10….}。如果状态机没有安全编码保护，状态机就会挂死在不良状态。

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多说一点，为了处理亚稳态，识别异步信号需要的时间就较长(2拍或者更多)，这就是目前流行的同步设计的代价。异步设计较好的解决了这个问题，异步设计靠硬件握手机制来反馈什么时候识别成功。有兴趣的朋友可以了解一下一个新兴的FPGA公司Achronix。

作为对比，我们看看图5中的wrong method. 触发器在接收异步信号后，产生了亚稳态。由于经过了组合逻辑和走线的延长，亚稳态传播到目的寄存器的时间*很多。这种情况下，只有在很低速的时钟频率时，第二拍触发器才可以避免亚稳态。因此是不正确的处理方法。