迅辉触发器(图)|触发器晒版灯|触发器

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D触发器（data flip-flop或delay flip-flop）由6个与非门组成，其中G1和G2构成基本RS触发器。电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。而边沿触发器允许在CP触发沿来到*瞬间加入输入信号。这样，输入端受干扰的时间大大缩短，受干扰的可能性就降低了。边沿D触发器也称为维持-阻塞边沿D触发器。

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1. 理论上讲，如果亚稳态不能够在一个时钟周期内返回到稳定态，那么目的寄存器也会发生亚稳态。这就是亚稳态的传播。

2. 亚稳态的毛刺直接输出，有可能导致系统错误。比如毛刺信号送给CPU做中断，可能导致CPU产生错误的中断响应。

3. 采样到错误的电平，导致功能错误。这是逻辑设计人员****容易遇到的问题。****典型的例子是，假设有一个4bits one-hot编码的状态机。正常的功能只有四个状态0，2，4，8。但是这个状态机的有多个异步输入信号，那么就会发生亚稳态。我们知道，亚稳态返回到1或者0是随机的，这样就会出现状态机的输入有不良的组合，导致状态机进入到不良状态{1，3，5，6，7，9，10….}。如果状态机没有安全编码保护，状态机就会挂死在不良状态。